HK1285-7 16384K非易失性SRAM为16,777,216bit,完全静态非易失性存储SRAM组成8位2097052字长。每片NVRAM 有一个自带锂电源和控制电路,经常监视Vcc是否超过容许条件。当超过容许条件时,锂电源自动接通,写保护无条件启动以保护混淆数据.NVRAM能够直接用来替代现有的 M*8SRAM,符合普通字节宽度的36-pin DIP标准。HK1285-7 也提供了当无法提供能量时对迫近的处理器提供能量提供失败的输出。
HK1285-7 在WE(写使能)被禁止(high)且CE(片选)被选中(Low)并且OE(读信号)被使能(Low)执行一次读循环。21个地址输入线(A0-A20)指定的唯一的地址定义将要被访问。最后输入信号稳定后8位数据输出驱动器将在tACC时序内得到有效数据。
地址输入稳定后,HK1285-7 在WE和CE信号处于激活(低电平)状态为写模式。最后出现的CE或WE下降沿将决定写循环的开始,写循环终止于CE或WE前边的上升边沿。在写循环内所有地址输入必须保持有效。在下一个循环能被初始化前,WE写信号必须将高电平保持最少记录时间(tWR).写循环期间OE控制信号应当保持失效(高电平),避免总线冲突,如果输出总线已经有效(CE和OE激活),则写信号可以在tODW时序内从下降边沿开始禁止输出。
HK1285-7 为Vcc提供全部功能,当VCC大于4.5伏或4.75伏,写保护为4.35伏或4.75伏。当Vcc掉电时保存数据,没有任何附加支持电路的需要。HK1285-7通常监视Vcc。如果电源电压降低,RAM自动写保护其本身。所有对RAM的输入变为“不接收”,所有输出为高电阻。当Vcc降低到大约3.0伏时,电源转换电路将用锂电源向RAM供电保存数据。电压升高时,当Vcc升高到大约3.0伏时,电压转换电路将外部Vcc与RAM连接。正常RAM操作在Vcc超过4.5伏或4.75伏后能够重新开始。
HK1285-7 从半导体出厂均保证满电量。运输及使用中的重力加速度不应超出1.5G否则影响寿命。
HK1285-7验收期为1个月即自客户得到本产品后对以下各项性能指标进行验收,如果异议应在1个月内提出更换或退货。质量保证期即服务期为一年,如HK1285-7在一年内非使用问题而产生的产品质量问题并且未经使用损坏的经我公司检验认可可以给予更换。我公司拥有对以上条款的最终解释权。
HK1285-7 注:长期暴露在工作在以上最大范围下将影响使用周期
②HK1285-7 推荐操作条件 (0℃to70℃)PARAMETER | SYMBOL | MIN | TYP | MAX | UNITS |
Power Supply Voltage 1(HK1285-7) | Vcc | 4.5 | 5.0 | 5.5 | V |
Power Supply Voltage 1(HK1285-7N) | Vcc | 4.75 | 5.0 | 5.5 | V |
Logic1 | VIH | 2.2 | — | Vcc | V |
Logic0 | VIL | 0.0 | — | +0.8 | V |
PARAMETER | SYMBOL | MIN | TYP | MAX | UNITS |
Input Leakage Current | IIL | -5.0 | — | ﹢5.0 | mA |
I/O Leakage Current CE≤VIH≤Vcc | IIO | -5.0 | — | ﹢5.0 | mA |
Output Current @2.4V | IOH | -1.0 | — | — | mA |
Output Current @0.4V | IOL | 2.0 | — | — | mA |
Standby Current CE=2.2V | ICCS1 | — | 5.0 | 10.0 | mA |
Standby Current CE=Vcc-0.5V | ICCS2 | — | 3.0 | 5.0 | mA |
Operating Current | ICCO1 | — | 5 | 85 | mA |
Write Protection Voltage 1(HK1285-7) | VTP | 4.25 | 4.37 | 4.5 | V |
Write Protection Voltage 2(HK1285-7N) | VTP | 4.5 | 4.75 | 4.85 | V |
PARAMETER | SYM | HK1285-7-70 | HK1285-7-85 | HK1285-7-100 | UNITS | NOTES | |||
MIN | MAX | MIN | MAX | MIN | MAX | ||||
Read Cycle Time | tRC | 70 | — | 85 | — | 100 | — | ns | — |
Access Time | tACC | — | 70 | — | 85 | — | 100 | ns | — |
OE to Output Valid | tOE | — | 35 | — | 45 | — | 50 | ns | — |
OE To Output Valid | tCO | — | 70 | — | 85 | — | 100 | ns | — |
OE or CE to Output Active | tCOE | 5 | — | 5 | — | 5 | — | ns | 5 |
Output High ZfromDissection | tOD | — | 25 | — | 30 | — | 35 | ns | 5 |
Output Hold from Address change | tOH | 5 | — | 5 | — | 5 | — | ns | — |
Write Cycle Time | tWC | 70 | — | 85 | — | 100 | — | ns | |
Write Pulse Width | tWP | 55 | — | 65 | — | 75 | — | ns | 3 |
Address Setup Time | tAW | 0 | — | 0 | — | 0 | — | ns | |
Write Recovery Time | tWR1tWR2 | 515 | — | 515 | — | 515 | — | ns | |
Output High Z From WE | tODW | — | 25 | — | 30 | — | 35 | ns | 5 |
Output Active from WE | tOEW | 5 | — | 5 | — | 5 | — | ns | 5 |
Data Setup Time | tDS | 30 | — | 35 | — | 40 | — | ns | 4 |
Data Hold Time | tDH1tDH2 | 010 | — | 010 | — | 010 | — | ns |
SYM | PARAMETER | MIN | MAX | UNITS | NOTES |
t PD | CE at VIH before Power-Down | 20 | — | μs | — |
tF | VCC Slew from 4.5V to 0V(CE at VIH) | 300 | — | μs | — |
t R | VCC Slew from 0V to 4.5V(CE at VIH) | 0 | — | μs | — |
t REC | CE WE at VIH after Power-UP | 2 | 125 | ms | — |
SYM | PARAMETER | MIN | TYP | MAX | UNITS | NOTES |
tDR | Expected Data Retention Time | — | 10 | — | years | 9,10 |
请技术人员在使用前仔细阅读英文资料,中文翻译仅为全部资料中的一部分。